Test MP+dmb.sy+po

AArch64 MP+dmb.sy+po
"DMB.SYdWW Rfe PodRR Fre"
Cycle=Rfe PodRR Fre DMB.SYdWW
Relax=
Safe=Rfe Fre PodRR DMB.SYdWW
Prefetch=0:x=F,0:y=W,1:y=F,1:x=T
Com=Rf Fr
Orig=DMB.SYdWW Rfe PodRR Fre
{
0:X1=x; 0:X3=y;
1:X1=y; 1:X3=x;
}
 P0          | P1          ;
 MOV W0,#1   | LDR W0,[X1] ;
 STR W0,[X1] | LDR W2,[X3] ;
 DMB SY      |             ;
 MOV W2,#1   |             ;
 STR W2,[X3] |             ;
exists
(1:X0=1 /\ 1:X2=0)