Test MP0181

PPC MP0181
"LwSyncdWW Rfe PodRW PodWR Fre"
Cycle=Rfe PodRW PodWR Fre LwSyncdWW
Relax=[Fre,LwSyncdWW,Rfe]
Safe=PodWR PodRW
Prefetch=0:x=F,0:y=W,1:y=F,1:x=T
Com=Rf Fr
Orig=LwSyncdWW Rfe PodRW PodWR Fre
{
0:r2=x; 0:r4=y;
1:r2=y; 1:r4=z; 1:r6=x;
}
 P0           | P1           ;
 li r1,1      | lwz r1,0(r2) ;
 stw r1,0(r2) | li r3,1      ;
 lwsync       | stw r3,0(r4) ;
 li r3,1      | lwz r5,0(r6) ;
 stw r3,0(r4) |              ;
exists
(1:r1=1 /\ 1:r5=0)