Test MP0094

PPC MP0094
"LwSyncdWW Rfe PodRW PodWR DpAddrdR Fre"
Cycle=Rfe PodRW PodWR DpAddrdR Fre LwSyncdWW
Relax=[Fre,LwSyncdWW,Rfe]
Safe=PodWR PodRW DpAddrdR
Prefetch=0:x=F,0:y=W,1:y=F,1:x=T
Com=Rf Fr
Orig=LwSyncdWW Rfe PodRW PodWR DpAddrdR Fre
{
0:r2=x; 0:r4=y;
1:r2=y; 1:r4=z; 1:r6=a; 1:r9=x;
}
 P0           | P1            ;
 li r1,1      | lwz r1,0(r2)  ;
 stw r1,0(r2) | li r3,1       ;
 lwsync       | stw r3,0(r4)  ;
 li r3,1      | lwz r5,0(r6)  ;
 stw r3,0(r4) | xor r7,r5,r5  ;
              | lwzx r8,r7,r9 ;
exists
(1:r1=1 /\ 1:r8=0)